Ανάπτυξη δομικών στοιχείων δρομολογητών για δίκτυα σε τσιπ (Network on Chip - NoC).
Φόρτωση...
Ημερομηνία
2012-11-01T10:54:15Z
Τίτλος Εφημερίδας
Περιοδικό ISSN
Τίτλος τόμου
Εκδότης
Τ.Ε.Ι. Κρήτης, Τεχνολογικών Εφαρμογών (Σ.Τ.Εφ), Τμήμα Μηχανικών Πληροφορικής Τ.Ε.
T.E.I. of Crete, School of Engineering (STEF), Department of Informatics Engineering
T.E.I. of Crete, School of Engineering (STEF), Department of Informatics Engineering
Επιβλέπων
Περίληψη
Σε λίγα χρόνια θα είναι εφικτό για τους σχεδιαστές να έχουν περισσότερους από 50 επεξεργαστές καθώς και μνήμες διαφόρων τύπων σε ένα μοναδικό τσιπ. Ένα νέο μοντέλο για την σχεδίαση τέτοιων συστημάτων σε τσιπ στηρίζεται σε Δίκτυα-σε-τσιπ (NoC) όπου ένα δίκτυο με βάση ευέλικτους δρομολογητές χρησιμοποιείται για την επικοινωνία των επεξεργαστών μέσα στο τσιπ, με χρήση πακέτων δεδομένων σταθερού μεγέθους. Πολύ σημαντικά θέματα δημιουργούνται για την σχεδίαση τέτοιων επεκτάσιμων δομών δικτύου. Η πτυχιακή εργασία αφορά την δημιουργία βασικών δομικών στοιχείων (δρομολογητών) επικοινωνίας και διασύνδεσης για πυρήνες μέσα σε ένα τσιπ. Η ανάπτυξη θα γίνει σε VHDL και σχηματικά και θα αναπτυχθεί δοκιμαστικό πρωτότυπο του συστήματος επικοινωνίας πάνω σε FPGA.
In a few years it will be possible for designers to have more than 50 processors and memories of various types in a single chip. A new model for the design of such a system on chip is based upon Network-on-chip (NoC) where a network based on flexible routers is used for the communication between processors in the chip, using a fixed packet size. Very important issues arise in the designing of such scalable network structures. This thesis concerns the development of key components (routers) and communication interfaces for cores within a chip. The development will be done in VHDL and schematics while a test prototype of the communication system will be developed on an FPGA.
In a few years it will be possible for designers to have more than 50 processors and memories of various types in a single chip. A new model for the design of such a system on chip is based upon Network-on-chip (NoC) where a network based on flexible routers is used for the communication between processors in the chip, using a fixed packet size. Very important issues arise in the designing of such scalable network structures. This thesis concerns the development of key components (routers) and communication interfaces for cores within a chip. The development will be done in VHDL and schematics while a test prototype of the communication system will be developed on an FPGA.